Quelle est la largeur d'arbre minimale d'un circuit sur pour calculer MAJ?
Ici MAJ sort 1 si au moins la moitié de ses entrées sont .
Je ne me soucie que de la taille du circuit (doit être polynomial) et qu'une entrée ne doit être lue qu'une seule fois bien que le fan-out d'une porte d'entrée puisse être arbitraire (cela affecte de manière cruciale la largeur d'arbre du circuit - la ramification les programmes obtenus à partir du théorème de Barrington du MAJ , interprétés comme des circuits asymétriques, n'aident pas). Et bien sûr, la largeur de l'arbre est la chose la plus cruciale. Je me fiche de la profondeur ou de tout autre paramètre.
Certains des circuits communs pour MAJ comprennent:
- Circuits d'arbre Wallace (par exemple le théorème 8.9 ici ) qui utilisent l'astuce 3-to-2 pour placer MAJ dans ?
- Circuits monotones \ mathsf {NC} ^ 1 de Valiant pour MAJ (par exemple Théorème 4 ici )
- profondeur réseau de tri tel que doseurs sorte
- Réseau de tri AKS
Certains d'entre eux ont-ils une largeur d'arbre bornée ou même polylogarithmique?
Ou en fait,
Y a-t-il des raisons de croire qu'il n'y a pas de circuits bornés de largeur d'arbre pour MAJ?
Notez que chaque fonction calculée par un circuit de largeur d'arbre borné peut être calculée par un circuit même en l'absence de stipulation de lecture unique via JansenSarma . Ainsi, l'improbabilité d'une telle famille de circuits indiquerait que cette limite peut être encore resserrée dans le cas de circuits à lecture unique.
Réponses:
Répondre à la moitié de la question de Samir.
Soit soit un DAG et soit deux sous - ensembles de sommets de . On note l'ensemble de tous les fronts dans avec un point d'extrémité dans et un autre point d'extrémité dans . Si est un ordre total des sommets de alors nous laissons dénote la largeur de . La largeur en ligne de est définie comme V 1 , V 2 ⊆ V G E ( V 1 , V 2 ) G V 1 V 2 ω = ( v 1 ,G=(V,E) V1,V2⊆V G E(V1,V2) G V1 V2 G o w ( G , ω ) = max iω=(v1,...,vn) G ω G o w ( G ) = min ω
Nous affirmons que la MAJORITÉ de bits peut être calculée dans la largeur en ligne , et donc dans la largeur d'arbre . Le circuit simule un algorithme en ligne qui lit un bit d'entrée à la fois et ajoute à un compteur avec bits si et seulement si . Au début, le compteur est initialisé àO ( log n ) O ( log n ) b b O ( log n ) b = 1 0 C = ( A D D 1 , A D Dn O(logn) O(logn) b b O(logn) b=1 0 . A la fin le circuit accepte si et seulement si la valeur du compteur est supérieure à n / 2. Il est facile de voir que les portes d'un circuit ADD qui en ajoute un au registre de compteur peuvent être ordonnées topologiquement de telle sorte qu'il ait une largeur en ligne constante, car ces circuits ont juste besoin de mettre en œuvre une opération de poursuite. Le circuit total est une séquence de circuits où la sortie de est connectée à l'entrée de et la sortie de est connectée à la entrée de COMP. Maintenant, si nous topologiquement le circuit total de telle manière que toutes les portes de apparaissent avant les portes de et toutes les portes deC=(ADD1,ADD2,...,ADDn,COMP) A D D i + 1 A D D n C A D D i A D D i + 1 A D D n O ( log n )ADDi ADDi+1 ADDn C ADDi ADDi+1 ADDn apparaît devant les portes de COMP, alors cet ordre topologique a une largeur en ligne . Cette construction est illustrée sur la figure 1 d' un de mes articles pour montrer que l'amplification des probabilités peut être effectuée en largeur logarithmique en ligne.O(logn)
Obs: La profondeur du circuit C est .O(n)
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Répondre à l'autre moitié de la question - voici un croquis de preuve pour une borne inférieure pour la largeur d'arbre pour une constante . La limite est indépendante de la taille ou de tout autre aspect du circuit. Dans le reste de l'argument est le circuit, est la largeur d'arbre de et est le nombre de portes d'entrée.c C t C nc⋅logn c C t C n
La première étape consiste à utiliser le lemme de séparateur équilibré pour les graphiques de largeur d'arbre bornée . Les portes (y compris les portes d'entrée) du circuit peuvent être divisées en trois parties , et , de sorte que et et contiennent au moinsdes portes d'entrée, et il n'y a pas d' arcs (fils) entre et .R S | S | ≤ t + 1 L R n / 3 - | S | L RL R S |S|≤t+1 L R n/3−|S| L R
Dans le reste de la preuve, la seule propriété du circuit que nous utiliserons est ce partitionnement - donc la preuve donne en fait une limite inférieure sur la taille d'un séparateur équilibré comme ci-dessus.S
Ayant à portée de main, nous construisons un circuit partir de comme suit: pour chaque porte dans faites deux portes et , et faisons et alimenter en . Pour tous les fils menant à de faites-les plutôt passer à . Pour tous les fils menant à de faites-les plutôt passer à . Soit C ′ C g S g L g R g L g R g g L g L g R g R S ′ = { g , g L , g R : g ∈ S } .(L,S,R) C′ C g S gL gR gL gR g g L gL g R gR
Pour chacune des affectations à créez un circuit qui produit 1 si (a) l'affectation aux portes d'entrée rend sortie vraie et (b) l'affectation aux portes d'entrée définit tous les portes de comme deviné. Appelez ces circuits , , pour . A noter que le circuit se décompose naturellement en deux sous- circuits et tels que ne dépend que des portes d'entrée de , ne dépend que des portes d'entrée de2|S′| S′ C′ S′ C1 C2 C3…Cx x≤8t Ci CLi CRi CLi L∪S′ CRi R∪S′ , et pour chaque affectation aux portes d'entrée , nous avons que .Ci=CLi∧CRi
Puisque chaque affectation aux portes d'entrée est cohérente avec une certaine estimation de ce qui se passe dans nous avons que . Ainsi, nous avons réécrit le circuit comme un OU (de fanin ) de ET (de fanin ) où le numéro de porte ET est alimenté en sortie de et respectivement.S′ C′=C1∨C2∨C3…∨Cx C 8t 2 i CLi CRi
Soit l'ensemble des portes ET les plus hautes. Nous allons d'abord prouver que. Cela donne un simple borne inférieure sur . Nous prouverons alors une meilleure limite.Z 2|Z|≥n/3−|S| loglogn t
Supposons queEt supposer sans perte de généralité que contient moins de portes d'entrée que . Alors et contiennent au moinsportes d'entrée. Selon le principe du pigeon, il y a deux nombres différents et tels qu'il y a deux affectations différentes aux portes d'entrée de , celle qui définit les portes à vrai, celle qui définit , de sorte que les circuits , produisent tous la même chose. Mais il existe une affectation aux portes d'entrée dans2|Z|<n/3−|S| L R L R n/3−|S| i j L i j CL1 CL2…CLx R de telle sorte que MAJORITY délivre FALSE si gates dans sont définies sur true et MAJORITY sort TRUE si gates dans sont définies sur true. Ceci est une contradiction et donc ce qui implique que l'arborescence est au moins .i L j L 2|Z|≥n/3−|S| loglogn
Nous montrons maintenant une meilleure limite:. On suppose que wlog contient moins de portes d'entrée que . Alors L et R contiennent au moinsportes d'entrée. Considérez l'affectation « tout faux » à . Soit le plus petit nombre de portes d'entrée de qui doit être mis à vrai de telle sorte que MAJ génère VRAI, étant donné que tout est mis à faux.|Z|≥n/3−|S| L R n/3−|S| L r R L
Depuis la mise à tous faux et exactement portes d' entrée de à sortie véritables marques MAJORITÉ il doit y avoir un tel que sorties TRUE, WLOG cela est . Toutes les affectations à avec moins de vraies portes d'entrée doivent définir sur false. Étant donné que le réglage de porte d'entrée de sur vrai et les portes d'entrée de sur vrai rendent la sortie MAJORITÉ , le réglage de porte de sur vrai doit faire au moins unr R 1 i C L i C L 1 R r C R 1 1 L r - 1 R 1 1 L C L i i ≠ 1 i = 2 R r - 2 C R 2 r | Z | ≥ r ≥ n / 3 - | S | c ⋅ log n tL r R 1 i CLi CL1 R r CR1 1 L r−1 R 1 1 L CLi outpur true pour . wlog on peut supposer que . Ensuite, toutes les affectations à qui définissent au plus portes d'entrée sur true doivent définir sur false, et ainsi de suite - nous pouvons répéter cet argument fois. Mais cela signifie que, donnant une limite inférieure pour .i≠1 i=2 R r−2 CR2 r |Z|≥r≥n/3−|S| c⋅logn t
[Je suis conscient que ce croquis devient un peu ondulé à la main à certains endroits, demandez si quelque chose n'est pas clair ...]
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